Architectures des systèmes informatiques
Code UE : NSY104
Public et conditions d'accès
Connaissances générales du fonctionnement d'un ordinateur et de son système d'exploitation, idéalement avoir suivi et/ou validé NFA004
Des connaissances en programmation sont souhaitées.
Des connaissances en programmation sont souhaitées.
Objectifs pédagogiques
L'objectif de cet enseignement est d'étudier l'architecture des systèmes informatiques et de leur parallélisme à différentes échelles, depuis le processeur jusqu'aux systèmes multi-ordinateurs. Cet enseignement permet d'acquérir une vision d'ensemble des moyens disponibles pour augmenter les performances d'un système, tout en assimilant les détails et enjeux de chaque famille de solution étudiée.
Compétences visées
- savoir identifier les grandes étapes de l'évolution des ordinateurs ;
- en comprendre les faits et les causes ;
- connaître les fonctions des différents composants d'un système ;
- déterminer l'impact de chaque composant et de leurs assemblages sur les performances globales ;
- expliquer les facteurs qui gouvernent l'évolution actuelle et future du domaine en termes de théorie, de caractéristiques, de puissance et de coûts relatifs.
- savoir mener une veille technologique automatisée
- en comprendre les faits et les causes ;
- connaître les fonctions des différents composants d'un système ;
- déterminer l'impact de chaque composant et de leurs assemblages sur les performances globales ;
- expliquer les facteurs qui gouvernent l'évolution actuelle et future du domaine en termes de théorie, de caractéristiques, de puissance et de coûts relatifs.
- savoir mener une veille technologique automatisée
Contenu
- Rappels d'architecture des machines, processeurs, mémoires, cache, OS
- Architecture de processeur pipeline, superscalaire, VLIW
- Architecture des systèmes multiprocesseurs
- Architecture des systèmes multi-ordinateurs
- Architecture des systèmes de stockage
- APIs: OpenMP, CUDA, MPI, OpenCL
- Architecture des systèmes à haute disponibilité
- Introduction aux architectures embarquées
- Architecture de processeur pipeline, superscalaire, VLIW
- Architecture des systèmes multiprocesseurs
- Architecture des systèmes multi-ordinateurs
- Architecture des systèmes de stockage
- APIs: OpenMP, CUDA, MPI, OpenCL
- Architecture des systèmes à haute disponibilité
- Introduction aux architectures embarquées
Modalité d'évaluation
Un examen final pour tous, 50% de la note finale.
Cours HTO : un examen partiel 50% de la note finale.
FOD : contrôle continu 50% de la note finale.
Cours HTO : un examen partiel 50% de la note finale.
FOD : contrôle continu 50% de la note finale.
Bibliographie
- John Hennessy, David-A Patterson : Architecture des ordinateurs, une approche quantitative
- Andrew Tanenbaum : Architecture de l'ordinateur
- René J. Chevance : Serveurs multiprocesseurs, clusters et architectures parallèles
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Contact
EPN05 - Informatique
33.1.13A, 2 rue Conté
75003 Paris
Tel :01 40 27 28 49
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75003 Paris
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Voir les dates et horaires, les lieux d'enseignement et les modes d'inscription sur les sites internet des centres régionaux qui proposent cette formation
UE
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Paris
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Paris
- 2018-2019 1er semestre : Présentiel
- 2018-2019 2nd semestre : Fod accessible nationalement
- 2019-2020 1er semestre : Présentiel
- 2019-2020 2nd semestre : Fod accessible nationalement
- 2020-2021 1er semestre : Présentiel
- 2020-2021 2nd semestre : Fod accessible nationalement
Comment est organisée cette formation à distance ?Planning
Date limite d'inscription : 25/03/2019
Date de démarrage : 10/02/2019
Date de la première session d'examen :00/00/0000
Date de la deuxième session d'examen :00/00/0000Accompagnement collectif
Rendez-vous :
Chat :
Forum par UE :oui
Webconférence :Accompagnement individuel
Echange par mails : oui
Accompagnement téléphonique :Regroupement
Séances de regroupement : nonModalités de validation
Examen sur table :oui
Projet : non
Contrôle continu : non
Examen partiel : non
:
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Paris
-
Paris
-
-
Ile-de-France (sans Paris)
-
Noisy-le-Grand
Comment est organisée cette formation à distance ?
Planning
Date limite d'inscription : 30/11/2017
Date de démarrage : 09/10/2017
Date de la première session d'examen :31/01/2018
Date de la deuxième session d'examen :13/04/2018Accompagnement collectif
Rendez-vous :
Chat : oui
Forum par UE :oui
Webconférence :Accompagnement individuel
Echange par mails : oui
Accompagnement téléphonique :Regroupement
Séances de regroupement : nonModalités de validation
Examen sur table :non
Projet : non
Contrôle continu : non
Examen partiel : non
:
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Noisy-le-Grand
-
Ile-de-France (sans Paris)
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Bretagne
- Lannion
- Brest
- Rennes
- Saint-Brieuc
- Lorient
- Vannes
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Bretagne
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Centre Val-de-Loire
- Blois
- Bourges
- Orléans
- Tours
- Chartres
- Châteauroux
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Centre Val-de-Loire
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La Réunion
- Saint Benoit
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La Réunion
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- Languedoc-Roussillon
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Code UE : NSY104
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